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芯片設(shè)計與開發(fā)：負責(zé)存算一體IP的存儲器單元、陣列的電路設(shè)計工作，參與芯片的架構(gòu)定義與設(shè)計，包括存儲單元、讀寫路徑、IO規(guī)劃等。開發(fā)存算一體芯片的陣列外圍電路模塊，如驅(qū)動、譯碼、冗余等電路，并進行存儲器建模、設(shè)計、仿真驗證和測試。
? 技術(shù)文檔與項目管理：編寫設(shè)計文檔，跟蹤技術(shù)演進方向，制定全面的芯片項目研究計劃，負責(zé)與代工廠的溝通、進度跟蹤和質(zhì)量控制，確保項目順利推進。
? 協(xié)同與合作：聯(lián)動工藝、設(shè)計、算法、架構(gòu)等團隊，規(guī)劃芯片方案，推動存算一體芯片開發(fā)，與其他團隊成員緊密合作，解決設(shè)計和開發(fā)過程中出現(xiàn)的問題。

任職要求:
? 教育背景：微電子、電子工程、計算機、集成電路等相關(guān)專業(yè)本科與碩士以上學(xué)歷。
? 專業(yè)技能：具備一定的模擬電路和數(shù)字電路基礎(chǔ)，熟練掌握Verilog硬件描述語言，熟悉IC設(shè)計流程，熟練使用Synopsys等EDA工具。
? 項目經(jīng)驗：具備SRAM或者憶阻器存儲器設(shè)計經(jīng)驗或存算一體電路設(shè)計經(jīng)驗者優(yōu)先，有成功流片經(jīng)驗和芯片調(diào)試經(jīng)驗者更佳。
? 其他能力：了解數(shù)據(jù)結(jié)構(gòu)、神經(jīng)網(wǎng)絡(luò)、機器學(xué)習(xí)算法等相關(guān)知識，具有良好的英文讀、寫能力，有較強的溝通能力和團隊精神。