職位描述
Verilog HDL電子/半導(dǎo)體/集成電路通信/網(wǎng)絡(luò)設(shè)備
核心職責(zé)?
1：系統(tǒng)設(shè)計與開發(fā)?
負責(zé)雷達信號處理系統(tǒng)的FPGA架構(gòu)設(shè)計、邏輯開發(fā)及算法移植，包括數(shù)字下變頻（DDC）、脈沖壓縮、動目標檢測（MTD）等模塊的優(yōu)化實現(xiàn)?；
主導(dǎo)Matlab/Simulink算法仿真與驗證，完成資源評估及FPGA硬件適配，確保實時性與低功耗需求?。
2?：接口與通信開發(fā)?
設(shè)計高速數(shù)據(jù)接口（如JESD204B、DDR3/DDR4、RapidIO）及FPGA與DSP間的實時通信協(xié)議，支持雷達系統(tǒng)多模塊協(xié)同工作?12；
解決硬件電路與邏輯設(shè)計的時序沖突，優(yōu)化信號完整性和系統(tǒng)穩(wěn)定性?34。
?文檔與測試支持?
3：編寫FPGA設(shè)計文檔（接口定義、測試方案、時序報告）及算法實現(xiàn)說明，參與系統(tǒng)聯(lián)調(diào)聯(lián)試?；
支持外場試驗，分析雷達數(shù)據(jù)并優(yōu)化算法參數(shù)，提升目標檢測與跟蹤精度?
技術(shù)攻關(guān)與維護?
1：針對雷達對抗、電子偵察等場景開發(fā)干擾抑制算法，優(yōu)化FPGA資源占用率及處理延遲?；
2：協(xié)助硬件團隊完成電路調(diào)試，提供FPGA固件升級及故障排查支持?。
?能力要求?
1?:專業(yè)技能?：
精通Verilog，熟練使用Vivado、Modelsim、matlab等工具鏈?；
熟悉雷達信號處理理論（如CFAR檢測、PDW參數(shù)測量）及數(shù)字通信系統(tǒng)鏈路仿真?；
具備J工、星載設(shè)備開發(fā)經(jīng)驗者優(yōu)先。
2?:協(xié)作要求?：
能獨立完成算法到硬件的全流程開發(fā)，并與軟硬件團隊高效協(xié)作?
工作地點
西安長安區(qū)軍民融合創(chuàng)新港24樓
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職位發(fā)布者
李女士/招聘經(jīng)理
昨日活躍立即溝通
西安寶威信息技術(shù)有限公司西安寶威信息技術(shù)有限公司是一家從事相控陣監(jiān)視雷達研發(fā)、生產(chǎn)及配套服務(wù)的高科技企業(yè)。公司主要產(chǎn)品為有源相控陣監(jiān)視雷達，可用于低空監(jiān)視安防、大區(qū)域地面/水面監(jiān)視安防，如邊境/油田周界/機場周界安防監(jiān)控、漁港/橋梁/港口/航道監(jiān)控、大型廠區(qū)監(jiān)控、便攜抵近偵察等。公司核心研發(fā)團隊深耕雷達設(shè)計領(lǐng)域十余年，團隊自研的低空反無人機系列和地面系列監(jiān)視雷達產(chǎn)品，突破了自適應(yīng)雜波處理、密集多目標檢測跟蹤、低成本小型化TR組件設(shè)計等關(guān)鍵技術(shù)，使該系列產(chǎn)品在市場同類產(chǎn)品競爭中，在環(huán)境適應(yīng)能力、智能化水平和成本方面，具有突出的優(yōu)勢。公司擁有齊全的研發(fā)儀器儀表設(shè)備，建設(shè)有專業(yè)的雷達實驗用微波暗室，開發(fā)了多種高自動化測試工具，沉淀形成了完整的開發(fā)、測試和生產(chǎn)流程，技術(shù)體系完備。公司將不斷致力于雷達系統(tǒng)前沿技術(shù)的探索和創(chuàng)新，持續(xù)為客戶提供優(yōu)質(zhì)的產(chǎn)品和服務(wù)。公司戰(zhàn)略定位：全球卓越雷達制造商。
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