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崗位職責：
1.參與和完成先進工藝高性能IP及常規(guī)Analog/Mixed Signal IP的設計；
2.指導layout人員完成IP的版圖設計；
3.協(xié)助測試人員完成各類IP的測試方案制定，完成性能測試。
崗位要求：
1.集成電路或微電子、計算機相關(guān)專業(yè)本科及以上學歷；
2.4年以上模擬IP版圖設計工作經(jīng)驗；希望有數(shù)字標準單元庫版圖的經(jīng)驗
3.能熟練使用主流IC版圖設計工具和驗證工具，如Virtuoso、Calibre等；能看懂不同F(xiàn)oundry的DRC/LVS rule file以及寄生參數(shù)的抽取；
4.熟悉CMOS logic/MS/RF工藝，PDK的內(nèi)容；
5.熟練掌握集成電路版圖設計的相關(guān)技巧和方法（如PCELL的建立、高精度匹配的實現(xiàn)、高速電路版圖實現(xiàn)，寄生參數(shù)優(yōu)化、閂鎖預防和串擾隔離等）；
6.會SKILL/Perl/TCL等編程語言優(yōu)先考慮。