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崗位職責：
1. 負責從電路設(shè)計到GDSII的完整標準單元庫開發(fā)流程，包括：邏輯單元、時序單元、特殊功能單元（如電平轉(zhuǎn)換器、隔離單元、延遲單元等）的設(shè)計與實現(xiàn)。
2. 使用行業(yè)主流EDA工具（如CadenceVirtuoso,SynopsysCustom
Compiler、華大九天Aether等）進行標準單元的電路圖設(shè)計、仿真、版圖設(shè)計與物理驗證（DRC/LVS/ERC/ANT）。
3. 為標準單元庫創(chuàng)建高質(zhì)量的Liberty(.lib)時序模型、功耗模型及各類標準輸入件（LEF,LIB,
GDS,CDL等）。
4. 對標準單元進行深入的性能、功耗和面積（PPA）分析與優(yōu)化，以滿足不同工藝角（Corner）和電壓下的設(shè)計需求。
5. 開發(fā)和支持自動化腳本（Python/Perl/Tcl等），以提升單元庫開發(fā)與驗證的效率。
6. 與CAD/PDK團隊緊密合作，定義和優(yōu)化單元庫的開發(fā)流程與方法學。
7. 為前端設(shè)計團隊和后端實現(xiàn)團隊提供技術(shù)支持，解決與標準單元相關(guān)的技術(shù)問題。
任職要求：
1. 本科及以上學歷，微電子、電子工程、集成電路等相關(guān)專業(yè)。
2. 掌握深亞微米工藝下的CMOS電路設(shè)計原理，熟悉晶體管的特性與版圖知識。
3. 熟練使用主流EDA工具，包括：
電路設(shè)計與仿真：CadenceVirtuoso/Spectre,Synopsys
HSPICE，華為九天Aethe等；
物理驗證：SiemensCalibre,SynopsysICValidator、華大九天Argus/Skipper等；
時序表征：SynopsysSiliconSmart/Primelib,
CadenceLiberate等；
具備良好的腳本編程能力，能使用Python/Tcl/Perl等語言進行自動化流程開發(fā)。
具備出色的分析問題和解決問題的能力，以及良好的團隊溝通與協(xié)作精神。
優(yōu)先考慮
? 有標準單元庫或模擬/定制電路設(shè)計的相關(guān)經(jīng)驗。
? 具有7nm及以下先進工藝節(jié)點標準單元庫開發(fā)經(jīng)驗。
? 具備豐富的全定制芯片版圖設(shè)計經(jīng)驗，深刻理解版圖對電路性能的影響。
? 了解數(shù)字后端實現(xiàn)流程（PnR）及單元庫在實現(xiàn)工具中的使用。