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崗位職責
1.架構(gòu)與方案設計：負責SoC的架構(gòu)設計，并對設計進行建模，仿真，保證滿足設計目標，結(jié)合產(chǎn)品需求與技術趨勢，確定芯片的功能模塊、接口定義、性能指標等關鍵參數(shù)，輸出高質(zhì)量的架構(gòu)文檔與設計規(guī)范，為后續(xù)開發(fā)提供清晰指引。
2.設計開發(fā)與管控：統(tǒng)籌 SOC 芯片的前端設計工作，包含SoC頂層、PCIe，DDR，UCIe等高速接口和MPU等子系統(tǒng)等的RTL設計，集成，驗證。建立設計評審機制，對關鍵設計節(jié)點進行嚴格把控，及時發(fā)現(xiàn)并解決設計中的技術難題。
3.統(tǒng)籌負責SoC時鐘、復位、總線、低功耗、調(diào)試和管理等功能設計。
4.負責尋找芯片設計所需IP和IP的evaluation工作。
5.協(xié)助芯片硅前驗證工作，包括FPGA原型測試和emulation測試的規(guī)劃，調(diào)試，驗證。
6.協(xié)助芯片的硅后驗證工作，包含芯片的功能，性能，功耗，穩(wěn)定性，可靠性測試和characterization工作。
7.作為后端設計接口人，對后端設計提供技術支持。
8.協(xié)助產(chǎn)品團隊完成芯片的量產(chǎn)測試，提高產(chǎn)品的良率。
9.團隊管理與技術提升：管理設計團隊，合理分配設計任務，制定項目開發(fā)計劃，跟蹤項目進度，確保項目按時完成。組織團隊成員進行技術學習與交流，提升團隊整體的設計能力與創(chuàng)新意識，培養(yǎng)核心技術人才。
10.跨部門協(xié)作與資源協(xié)調(diào)：與驗證、后端、軟件、市場等部門保持緊密溝通與協(xié)作，明確各部門在芯片設計過程中的職責與接口，協(xié)調(diào)解決跨部門協(xié)作中出現(xiàn)的問題。合理調(diào)配公司內(nèi)部的技術資源與設備資源，保障設計工作的順利開展。
11.技術文檔與知識產(chǎn)權管理：組織編寫和完善芯片設計過程中的各類技術文檔，如設計說明書、用戶手冊等，確保文檔的準確性、完整性和規(guī)范性。重視知識產(chǎn)權保護，推動團隊進行專利申請與技術創(chuàng)新，維護公司的核心技術權益。
任職要求
1.教育背景：微電子、電子工程、計算機科學與技術等相關專業(yè)，碩士及以上學歷，博士學歷優(yōu)先。
2.工作經(jīng)驗：具有5年以上 SOC 芯片設計經(jīng)驗，其中 4 年以上團隊管理經(jīng)驗，至少主導過 2 款以上成功量產(chǎn)的 GPU 或高性能 SOC 芯片設計項目，熟悉芯片從架構(gòu)設計到量產(chǎn)的全流程，有在GPGPU公司相關工作經(jīng)驗。有先進工藝節(jié)點設計經(jīng)驗；有成功流片經(jīng)驗和產(chǎn)品量產(chǎn)經(jīng)驗；
3.專業(yè)技能：
?精通 SOC 芯片架構(gòu)設計，熟悉 CPU、GPU等核心處理器的工作原理與接口特性，能夠根據(jù)產(chǎn)品需求進行合理的架構(gòu)選型與優(yōu)化。
?熟練掌握 Verilog/VHDL 等硬件描述語言，具備扎實的數(shù)字電路設計基礎，能夠獨立完成復雜模塊的 RTL 設計與仿真驗證。
?熟悉 AMBA、NoC、PCIe、DDR 等主流總線協(xié)議與接口標準，了解低功耗設計技術（如 DVFS、Power Gating 等），能夠在設計中有效應用以滿足產(chǎn)品的功耗要求。
?掌握主流的 EDA 設計工具（如 Synopsys、Cadence 系列工具），熟悉芯片設計流程中的時序分析、功耗分析、可測性設計等關鍵環(huán)節(jié)。
?熟悉低功耗設計流程，有upf/cpf設計經(jīng)驗。
?有RISC-V CPU、PCIe、DDR等IP的選型和集成經(jīng)驗。
?有clock、reset、debug、AXI總線等設計和集成經(jīng)驗。
4.能力素質(zhì)：具備良好的技術領導力與決策能力，能夠準確把握行業(yè)技術發(fā)展趨勢，為團隊制定合理的技術發(fā)展方向。擁有出色的溝通協(xié)調(diào)能力與團隊合作精神，能夠有效推動跨部門項目的進展。具有高度責任感，具備較強的抗壓能力與解決復雜問題的能力，能夠適應高強度、快節(jié)奏的工作環(huán)境。
工作地點：珠海，深圳，西安，北京（任選一）