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崗位職責：
1、負責SoC數字電路從RTL到netlist的實現工作；
2、負責編寫和檢查時序約束文件；
3、負責和后端工程師一起完成整個設計的時序收斂；
4、負責UT驗證，優(yōu)化SoC電路設計方法學。
崗位要求：
1、微電子或相關專業(yè)，5年及以上數字前端設計相關經驗；
2、精通Verilog，精通DC/FM/PT等工具；
3、熟悉邏輯綜合及時序收斂等數字前端設計流程；
4、較強的腳本（Python,Shell等）編程能力；
5、具備DFT經驗的優(yōu)先；
6、具備FinFET制程或設計經驗優(yōu)先。