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更新于 3月10日
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舉報(bào)

硬件設(shè)計(jì)工程師

1.5-2.5萬(wàn)

職位描述

通信/網(wǎng)絡(luò)設(shè)備
崗位職責(zé)：
1、負(fù)責(zé)高速交換機(jī)交換板硬件開(kāi)發(fā)；
2、負(fù)責(zé)單板方案設(shè)計(jì)、原理圖設(shè)計(jì)、CPLD代碼開(kāi)發(fā)，協(xié)助完成PCB設(shè)計(jì)等開(kāi)發(fā)設(shè)計(jì)工作；
3、負(fù)責(zé)器件選型、BOM制作、物料采購(gòu)跟蹤，板卡生產(chǎn)跟蹤，整機(jī)試制跟蹤等；
4、負(fù)責(zé)回板調(diào)試驗(yàn)證、問(wèn)題定位、debug等；
5、負(fù)責(zé)生產(chǎn)問(wèn)題定位、產(chǎn)品硬件問(wèn)題定位、售后類硬件問(wèn)題解決支撐等；
6、負(fù)責(zé)各個(gè)階段文檔制作和歸檔；
崗位要求：
1、教育背景：本科及以上學(xué)歷，通信類、電子類等相關(guān)專業(yè)；
2、3年以上硬件開(kāi)發(fā)經(jīng)驗(yàn)，有網(wǎng)絡(luò)設(shè)備行業(yè)背景優(yōu)先；
3、具備高速交換機(jī)硬件設(shè)計(jì)經(jīng)驗(yàn)，熟悉高速接口設(shè)計(jì)，有Serdes，PCIE，存儲(chǔ)接口相關(guān)經(jīng)驗(yàn)優(yōu)先；
4、有一定的Verilog邏輯基礎(chǔ)，有CPLD/FPGA相關(guān)開(kāi)發(fā)調(diào)試經(jīng)驗(yàn)者優(yōu)先；
5、良好的團(tuán)隊(duì)合作能力，較強(qiáng)的溝通表達(dá)能力以及抗壓能力。

工作地點(diǎn)

長(zhǎng)沙開(kāi)福區(qū)凱樂(lè)微谷電子商務(wù)總部基地(商住樓)

認(rèn)證資質(zhì)

營(yíng)業(yè)執(zhí)照信息

職位發(fā)布者

原燕妮/人事經(jīng)理

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