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崗位職責(zé)：
1、參與模塊spec制定，完成架構(gòu)設(shè)計和模塊定義；
2、完成新IP設(shè)計，包括verilog代碼編寫，仿真驗證；
3、數(shù)字電路的綜合，時序驗證，版圖布局布線后的時序分析，一致性檢查等；
4、完成新產(chǎn)品的silicon validation和debug相關(guān)工作直至量產(chǎn)。
任職要求：
1、微電子、集成電路設(shè)計、電子信息工程碩士及以上學(xué)歷；
2、有熟練使用Verilog，有全流程，實際產(chǎn)品tapeout項目經(jīng)驗尤佳;
3、熟練MCU常見外設(shè)或圖像視頻顯示驅(qū)動等經(jīng)驗者優(yōu)先；
4、有車規(guī)芯片設(shè)計經(jīng)驗者優(yōu)先；
5、較強的溝通能力，團隊協(xié)作能力、學(xué)習(xí)能力。