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工作職責(zé)
· 參與芯片架構(gòu)設(shè)計(jì)、模塊劃分和接口定義
· 使用 Verilog/SystemVerilog 進(jìn)行 RTL 代碼編寫和仿真驗(yàn)證
· 協(xié)助進(jìn)行綜合、時(shí)序分析、形式驗(yàn)證等前端設(shè)計(jì)流程
· 編寫設(shè)計(jì)文檔和技術(shù)報(bào)告
· 與團(tuán)隊(duì)成員緊密合作，完成項(xiàng)目目標(biāo)
任職要求
· 電子工程、微電子、計(jì)算機(jī)科學(xué)等相關(guān)專業(yè)本科或碩士在讀
· 熟悉數(shù)字電路設(shè)計(jì)基礎(chǔ)，了解計(jì)算機(jī)體系結(jié)構(gòu)
· 熟悉 Verilog/SystemVerilog 硬件描述語(yǔ)言
· 熟悉 Linux 操作系統(tǒng)和常用 EDA 工具
· 良好的溝通能力和團(tuán)隊(duì)合作精神
· 積極主動(dòng)，學(xué)習(xí)能力強(qiáng)，對(duì)芯片設(shè)計(jì)充滿熱情
加分項(xiàng)
· 有 FPGA 開發(fā)經(jīng)驗(yàn)
· 了解 UVM 驗(yàn)證方法學(xué)
工作地點(diǎn)：上海