職位描述
Verilog HDLVHDLISEQuartusLiberotestbench仿真時(shí)序分析電子/半導(dǎo)體/集成電路
FPGA崗位職責(zé)：
1、具有2年以上軍G項(xiàng)目FPGA測(cè)試經(jīng)驗(yàn)；
2、熟練使用HDL designer、vincent、Modelsim等測(cè)試工具；
3、熟練掌握第三方測(cè)試流程，具備獨(dú)立完成GJB 9433測(cè)試要求的能力（代碼審查、邏輯測(cè)試、時(shí)序測(cè)試、動(dòng)態(tài)測(cè)試含仿真等）；
4、熟練掌握VHDL、Verilog硬件描述語言，具備代碼走查能力；
5、能依據(jù)需求編寫測(cè)評(píng)大綱、提取測(cè)試用例，并進(jìn)行測(cè)試總結(jié)，撰寫測(cè)評(píng)報(bào)告等文檔；
6、熟練使用Vivado、ISE、QuartusII等開發(fā)工具；
7、具備研究所工作經(jīng)驗(yàn)者優(yōu)先，溝通能力強(qiáng)且有較強(qiáng)解決問題能力者優(yōu)先。
1、具有2年以上軍G項(xiàng)目FPGA測(cè)試經(jīng)驗(yàn)；
2、熟練使用HDL designer、vincent、Modelsim等測(cè)試工具；
3、熟練掌握第三方測(cè)試流程，具備獨(dú)立完成GJB 9433測(cè)試要求的能力（代碼審查、邏輯測(cè)試、時(shí)序測(cè)試、動(dòng)態(tài)測(cè)試含仿真等）；
4、熟練掌握VHDL、Verilog硬件描述語言，具備代碼走查能力；
5、能依據(jù)需求編寫測(cè)評(píng)大綱、提取測(cè)試用例，并進(jìn)行測(cè)試總結(jié)，撰寫測(cè)評(píng)報(bào)告等文檔；
6、熟練使用Vivado、ISE、QuartusII等開發(fā)工具；
7、具備研究所工作經(jīng)驗(yàn)者優(yōu)先，溝通能力強(qiáng)且有較強(qiáng)解決問題能力者優(yōu)先。
崗位要求：
1、大專及以上學(xué)歷
2、具備2年的經(jīng)驗(yàn)
3、有第三方經(jīng)驗(yàn)
4、必須具備航空、航天、軍G、武Q類測(cè)試
工作地點(diǎn)
北京大興區(qū)首開萬科中心
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