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崗位職責(zé)：
1) 負(fù)責(zé)無刷電機控制與驅(qū)動技術(shù)研發(fā)，負(fù)責(zé)繪制電路原理圖及PCB，完成產(chǎn)品設(shè)計和開發(fā)，完成調(diào)試及生產(chǎn)所需的細(xì)則、規(guī)范等操作文件的編寫；
2) 負(fù)責(zé)制定測試計劃及測試方案，搭建測試環(huán)境，完成測試及調(diào)試；
3) 負(fù)責(zé)維護(hù)、管理、升級所開發(fā)的硬件平臺，積極思考和解決開發(fā)/測試過程中遇到的問題，及時解決客戶提出的各項疑問；
4) 負(fù)責(zé)配合軟件人員完成產(chǎn)品測試。
任職要求：
1) 熟悉自動控制原理、電機及電機控制與驅(qū)動工作原理；
2) 熟練使用Cadence或AD、Protel等EDA開發(fā)工具進(jìn)行電機控制、驅(qū)動等電路設(shè)計，具備多層板開發(fā)經(jīng)驗；
3) 具備常見的模擬、數(shù)字電路理論基礎(chǔ)，熟悉常見的接口協(xié)議如I2C、SPI、UART、CAN、RS485/RS422、1553B、TCP/IP等，具備硬件debug經(jīng)驗和能力，具備實際設(shè)計能力；
4) 熟悉電機控制中常見傳感器的應(yīng)用及測試；
5) 熟悉基本的BLDC控制算法、直流無刷及永磁同步電機矢量控制算法；
6) 具有FPGA、DSP、ARM硬件電路、永磁同步電機驅(qū)動開發(fā)經(jīng)驗，獨立開發(fā)過類似項目；
7) 具備一定的C語言、VerilogHDL語言編程能力，能夠獨立完成基于DSP、FPGA平臺的軟件開發(fā)工作；
8) 電力電子、電氣工程與自動化、自動控制、控制理論與控制工程、電機與電器等相關(guān)專業(yè)；
9) 科研院所本科或者碩士研究生以上學(xué)歷畢業(yè)，具有3年及以上軍品領(lǐng)域相關(guān)工作經(jīng)驗者優(yōu)先；
10) 年齡在35周歲（含）以下，技能優(yōu)秀者可適當(dāng)放寬工作年限和年齡要求。
工資、社保、福利等薪酬標(biāo)準(zhǔn)：
1）月薪15k至45k，依據(jù)實際能力水平來核定基準(zhǔn)，分為基本、崗位和績效三部分，績效部分按月度、季度和年度進(jìn)行考核；
2）如果做出特別突出的貢獻(xiàn)可以額外發(fā)放專項獎勵，能力和貢獻(xiàn)特別突出者可以考慮期權(quán)和股權(quán)激勵；
3）試用期時限、勞動合同條款、五險一金、帶薪休假等按照國家有關(guān)法律法規(guī)的標(biāo)準(zhǔn)和要求執(zhí)行；
4）提供午餐補助、交通費等補貼；
5）公司提供每年一次的定期體檢、定期團(tuán)建、節(jié)日慰問；
6）上下班時間為早09：00至晚06：00。