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1. 負(fù)責(zé)伺服驅(qū)動(dòng)器軟件架構(gòu)設(shè)計(jì)與軟件功能模塊任務(wù)實(shí)現(xiàn)；
2. 負(fù)責(zé)伺服驅(qū)動(dòng)器控制邏輯實(shí)現(xiàn)，以及EtherCAT從站、COE軟件實(shí)現(xiàn)；
3. 主導(dǎo)高精度伺服驅(qū)動(dòng)系統(tǒng)核心算法研發(fā)，涵蓋磁場(chǎng)定向控制（FOC）、三環(huán)控制（位置/速度/電流）及先進(jìn)控制策略的設(shè)計(jì)與優(yōu)化；
4. 構(gòu)建電機(jī)動(dòng)態(tài)數(shù)學(xué)模型，運(yùn)用MATLAB/Simulink進(jìn)行仿真與參數(shù)辨識(shí)，確保算法在不同工況下的穩(wěn)定性和高效性，縮短開(kāi)發(fā)周期，降低開(kāi)發(fā)成本；
5. 負(fù)責(zé)核心控制算法在嵌入式平臺(tái)（如DSP、ARM Cortex-M/R）上的C/C++代碼實(shí)現(xiàn)、優(yōu)化與集成；
6. 負(fù)責(zé)解決SVPWM控制技術(shù)、基于FPGA的電流環(huán)控制技術(shù)、永磁同步電機(jī)閉環(huán)矢量控制軟件架構(gòu)等問(wèn)題；
7. 解決伺服系統(tǒng)在高速、高精度、高負(fù)載、復(fù)雜工況下的穩(wěn)定性、響應(yīng)速度、抗擾能力等關(guān)鍵技術(shù)挑戰(zhàn)；
8. 負(fù)責(zé)伺服軟件驗(yàn)證方案的制定與組織實(shí)施;
9. 負(fù)責(zé)伺服軟件的調(diào)試、自測(cè)與維護(hù)。




2 崗位要求
1. 本科以上學(xué)歷，電力電子、自動(dòng)化等相關(guān)專業(yè)，且具備5年以上相關(guān)經(jīng)驗(yàn)；
2. 熟悉主流DSP、ARM嵌入式軟件開(kāi)發(fā)，具備較強(qiáng)的驅(qū)動(dòng)底層開(kāi)發(fā)能力；
3. 精通自動(dòng)控制原理與電機(jī)控制相關(guān)知識(shí)及算法，熟悉數(shù)字信號(hào)處理相關(guān)算法，可獨(dú)立完成常用數(shù)字濾波器設(shè)計(jì)；
4. 精通MATLAB常用數(shù)值計(jì)算與系統(tǒng)建模方法，能獨(dú)立完成仿真建模；
5. 從事電機(jī)伺服控制類產(chǎn)品開(kāi)發(fā)與研究者優(yōu)先；
6. 熟練掌握FPGA設(shè)計(jì)方法，熟悉Xilinx、Altera等公司FPGA/CPLD器件，有國(guó)產(chǎn)FPGA項(xiàng)目開(kāi)發(fā)經(jīng)驗(yàn)者優(yōu)先；
7. 精通FPGA設(shè)計(jì)，能熟練的對(duì)時(shí)序進(jìn)行約束和處理，熟練使用數(shù)字電路仿真測(cè)試工具；
8. 有編碼器接口、EtherCAT從站、電流環(huán)等FPGA實(shí)現(xiàn)項(xiàng)目經(jīng)驗(yàn)者優(yōu)先；
9. 了解日系或歐美主流伺服驅(qū)動(dòng)產(chǎn)品的功能性能，具備競(jìng)品分析經(jīng)驗(yàn)，在部分算法上有自己獨(dú)到的理解。
5年以上伺服開(kāi)發(fā)經(jīng)驗(yàn)，具有通用伺服產(chǎn)品底層軟件開(kāi)發(fā)經(jīng)驗(yàn)者優(yōu)先，熟悉電機(jī)建模，振動(dòng)抑制、卡爾曼濾波等算法者優(yōu)先,熟悉功能安全標(biāo)準(zhǔn)（如IEC 61508、ISO13849-1）者優(yōu)先。