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FPGA圖像融合處理工程師 全職 | 技術研發(fā)崗 崗位使命 負責設計并實現(xiàn)基于FPGA的高性能圖像融合處理系統(tǒng)，通過硬件加速技術優(yōu)化多源傳感器（紫外/可見光/紅外/激光雷達等）的實時圖像融合算法，提升目標檢測精度與系統(tǒng)響應速度，優(yōu)化高速圖像拖尾，滿足在線監(jiān)控、無人機載、便攜式紫外成像儀、多光成像儀在電力、鐵路等場景的苛刻性能需求。 核心職責 1. **架構設計** - 主導FPGA圖像處理流水線架構設計，實現(xiàn)圖像配準、特征提取、像素級/特征級融合算法硬件化。 - 設計高速數(shù)據(jù)流接口（如Camera Link、CoaXPress）與DDR內(nèi)存控制方案，解決大數(shù)據(jù)吞吐瓶頸。 2. **算法加速與優(yōu)化** - 將MATLAB/Python原型算法轉化為并行FPGA硬件邏輯，優(yōu)化資源占用（LUT/BRAM/DSP）與時序（＞200MHz）。 - 開發(fā)基于HLS（Vitis HLS/OpenCL）或RTL（Verilog/VHDL）的融合處理IP核，支持動態(tài)權重自適應融合。 3. **系統(tǒng)集成與驗證** - 構建UVM/SystemVerilog驗證平臺，完成圖像融合模塊的功能覆蓋率與極限場景測試（低光照/運動模糊）。 - 協(xié)同嵌入式團隊開發(fā)Zynq MPSoC等平臺的PS-PL數(shù)據(jù)交互方案（AXI-DMA/VDMA）。 4. **性能提升** - 通過流水線重組、定點量化、近似計算等技術，降低處理延遲（目標：＜5ms @1080P）。 - 開發(fā)實時圖像質(zhì)量評估模塊（如QABF、EN），驅動算法迭代。 技能要求 # 必需技能 - 精通FPGA開發(fā)全流程： ? 語言：Verilog/VHDL + SystemVerilog驗證 ? 工具：Xilinx Vivado/Vitis, Intel Quartus, Modelsim - 圖像處理硬件化經(jīng)驗： ? 掌握圖像濾波/變換（FFT/DWT）/分割/融合常用算法硬件實現(xiàn) ? 熟悉OpenCV基礎操作與硬件加速原理 - 高速接口開發(fā)： ? 實戰(zhàn)經(jīng)驗：DDR3/4, AXI4-Stream,Camera Link/SDI, PCIe - 腳本能力：Python/Tcl（自動化測試與流程控制） 加分項 - 熟悉多傳感器融合（紫外+可見光+紅外/激光雷達）的硬件同步方案 - 有HLS實現(xiàn)CNN加速器（如YOLO分割網(wǎng)絡）經(jīng)驗 - 掌握Chisel/SpinalHDL等新型HDL工具 - 熟悉Petalinux驅動開發(fā)或VxWorks實時系統(tǒng)優(yōu)化 素質(zhì)要求 - 極強的算法并行化思維與資源優(yōu)化意識 - 能閱讀計算機視覺論文并快速工程化 - 具備跨團隊（算法/硬件/嵌入式）協(xié)作能力 - 對低延遲、高吞吐設計有極致追求 應聘方式 請?zhí)峤唬? 1. 簡歷（突出FPGA圖像處理項目指標：**分辨率/幀率/資源利用率/延遲/解決監(jiān)控場景運動拖影問題**） 2. 技術代表作說明（如GitHub鏈接/專利/白皮書） 3. 對如下場景的解決思路：如何在資源受限FPGA上實現(xiàn)4K@60fps的多雙波段紫外-紅外-可見光自適應融合？