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1. 負責設計、開發(fā)和維護系統(tǒng)信號完整性方案，確保設計的有效性和可靠性。
2. 參與產(chǎn)品開發(fā)過程中的設計評審，提出關于信號完整性的技術(shù)建議和改進方案。
3. 開發(fā)和維護信號完整性測試方法和流程，制定測試計劃并進行測試，提供測試報告和數(shù)據(jù)分析。
4. 分析系統(tǒng)集成中的問題，并提供解決方案，確保系統(tǒng)集成的高效運行。
5. 持續(xù)跟蹤和研究最新的信號完整性技術(shù)和工具，提出改進和創(chuàng)新的建議。
6. 主導服務器主板、背板、線纜等關鍵部件的高速信號（PCIe Gen5/6、DDR5、USB4、400G以太網(wǎng)等）全鏈路建模與仿真優(yōu)化，包括拓撲結(jié)構(gòu)設計、阻抗匹配、損耗補償、串擾抑制等。
7. 搭建高速信號測試平臺（如TDR/VNA/實時示波器），執(zhí)行眼圖測試、S參數(shù)測試、誤碼率分析（BERT）等，對比仿真與實測數(shù)據(jù)并迭代優(yōu)化設計。
8. 主導SI相關失效分析（如振鈴、反射、ISI問題），提供根因解決方案并推動設計/工藝改進
9. 跟蹤IEEE/PCI-SIG/OIF等組織技術(shù)標準演進（如PCIe Gen6、UCIe、224G PAM4），主導新協(xié)議接口的SI可行性研究與技術(shù)路徑規(guī)劃。
10. 探索AI服務器/液冷系統(tǒng)等新興場景下的SI挑戰(zhàn)（如散熱對介電性能影響、高密度布線串擾抑制）
11. 與硬件設計、PCB Layout、結(jié)構(gòu)散熱團隊緊密協(xié)作，推動SI設計規(guī)則在開發(fā)流程中的落地執(zhí)行。
12. 編制SI設計指南、測試報告等技術(shù)文檔，建立企業(yè)級SI知識庫并主導內(nèi)部技術(shù)培訓。
任職資格
1. 本科及以上學歷，電子工程、通信工程、物理學或相關專業(yè)。
2. 熟練掌握信號完整性分析工具和仿真軟件，如SPICE、IBIS、S-parameter等。
3. 有相關的服務器主板測試和分析經(jīng)驗。
4. 熟悉PCB設計流程和工具，具備一定的PCB設計經(jīng)驗，熟悉信號完整性布線和布局技術(shù)。
5. 具備較強的解決問題能力和創(chuàng)新思維，能夠獨立思考和解決復雜的信號完整性問題。
6. 具備良好的溝通和協(xié)調(diào)能力，能夠與多個團隊和部門進行有效的合作和協(xié)作。
7. 熟悉高速測試設備（≥33GHz示波器、VNA、TDR）操作與信號去嵌入（De-embedding）技術(shù)；
8. 熟悉服務器/數(shù)據(jù)中心硬件架構(gòu)，了解高速背板設計、電源完整性（PI）協(xié)同優(yōu)化方法。
9. 5年以上高速數(shù)字電路SI/PI設計經(jīng)驗，至少主導過2代PCIe（Gen4及以上）或DDR（DDR4及以上）完整項目開發(fā)。