職位描述
Verilog HDLPython電子/半導(dǎo)體/集成電路通信/網(wǎng)絡(luò)設(shè)備
招聘：3人
職責(zé)：負(fù)責(zé)完成基于FPGA的邏輯設(shè)計(jì)、開發(fā)和調(diào)試工作；編制規(guī)范的設(shè)計(jì)及開發(fā)文檔，協(xié)助制定產(chǎn)品測試流程；配合相關(guān)工作人員進(jìn)行整機(jī)調(diào)試。
要求：
1. 通信、電子相關(guān)專業(yè)背景；
2. 熟悉硬件電路、時(shí)序分析知識；
3. 熟練掌握VHDL語言、ALTERA FPGA設(shè)計(jì)流程、MODELSIM仿真流程；
4. 較強(qiáng)的分析解決問題的能力、工作盡職盡責(zé)、有合作精神；
5. 有調(diào)制解調(diào)FPGA設(shè)計(jì)工作經(jīng)驗(yàn)者優(yōu)先。
職責(zé)：負(fù)責(zé)完成基于FPGA的邏輯設(shè)計(jì)、開發(fā)和調(diào)試工作；編制規(guī)范的設(shè)計(jì)及開發(fā)文檔，協(xié)助制定產(chǎn)品測試流程；配合相關(guān)工作人員進(jìn)行整機(jī)調(diào)試。
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1. 通信、電子相關(guān)專業(yè)背景；
2. 熟悉硬件電路、時(shí)序分析知識；
3. 熟練掌握VHDL語言、ALTERA FPGA設(shè)計(jì)流程、MODELSIM仿真流程；
4. 較強(qiáng)的分析解決問題的能力、工作盡職盡責(zé)、有合作精神；
5. 有調(diào)制解調(diào)FPGA設(shè)計(jì)工作經(jīng)驗(yàn)者優(yōu)先。
職位福利：五險(xiǎn)一金、年底雙薪、績效獎(jiǎng)金、加班補(bǔ)助、帶薪年假、定期體檢
獎(jiǎng)金績效
年獎(jiǎng)1~3個(gè)月
工作地點(diǎn)
北京市海淀區(qū)中關(guān)村大街清華大學(xué)電子工程館
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清華大學(xué)-電子工程系寬帶傳輸研究室招聘清華大學(xué)寬帶傳輸研究室是國內(nèi)在衛(wèi)星高速數(shù)據(jù)傳輸技術(shù)領(lǐng)域最先展開研究的單位之一，研制的“遙感衛(wèi)星中頻通用接收解調(diào)系統(tǒng)”獲得2000年度國家技術(shù)發(fā)明獎(jiǎng)二等獎(jiǎng)，研制的“時(shí)域同步正交頻分復(fù)用接收機(jī)系統(tǒng)”分別獲得2009年度中國通信學(xué)會科學(xué)技術(shù)獎(jiǎng)一等獎(jiǎng)和北京市科學(xué)技術(shù)獎(jiǎng)二等獎(jiǎng)。目前研究室在衛(wèi)星/空間通信、雷達(dá)通信一體化、無線自組織網(wǎng)絡(luò)、隱蔽通信、超高速軟件無線電平臺等領(lǐng)域開展研發(fā)工作。本單位位列《裝備承制單位名錄》，獲清華大學(xué)國軍標(biāo)質(zhì)量體系認(rèn)證，并獲得GJB9001A-2001質(zhì)量體系認(rèn)證、二級保密資格單位及武器裝備科研生產(chǎn)許可證等證書。研究室為社招人員提供有競爭力的薪酬待遇，按照清華大學(xué)合同制人員聘用，享受清華大學(xué)合同制人員相應(yīng)待遇，社會保險(xiǎn)按照清華大學(xué)有關(guān)規(guī)定辦理。
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