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崗位職責
1. 負責高速數(shù)據(jù)采集系統(tǒng)的總體方案設計：FPGA+高速ADC/DAC架構評估、器件選型、信號鏈路預算與鏈路仿真。
2. 獨立完成FPGA硬件設計：原理圖設計、多層高速PCB Layout（≥8層）、電源完整性/信號完整性（PI/SI）仿真與優(yōu)化。
3. 負責ADC相關模擬前端電路設計：驅動放大器、低噪聲電源、時鐘分配、抗混疊濾波器、保持采樣電路設計與調(diào)試。
4. 主導板級調(diào)測與系統(tǒng)聯(lián)調(diào)：使用示波器、頻譜儀等儀器完成硬件調(diào)試、性能驗證及故障定位。
5. 撰寫并維護完整的技術文檔：需求規(guī)格、詳細設計、測試報告、BOM及生產(chǎn)工藝文件。
6. 配合嵌入式軟件、FPGA開發(fā)工程師，推進產(chǎn)品從原型到量產(chǎn)的完整生命周期管理。
任職要求：
1. 學歷：電子工程、通信工程、自動化等相關專業(yè)本科及以上學歷，碩士優(yōu)先。
2. 經(jīng)驗：豐富硬件開發(fā)經(jīng)驗，其中至少3年專注FPGA+高速ADC/DAC系統(tǒng)設計并成功量產(chǎn)。
3. ADC/DAC：熟悉12-16位、≥100 MSPS高速ADC/DAC芯片（ADI/TI/Linear等）及其模擬前端設計，掌握SFDR、SNR、ENOB等關鍵指標測試與優(yōu)化方法。
4. 儀器與調(diào)試：熟練使用示波器、邏輯分析儀、頻譜儀、網(wǎng)絡分析儀等測試設備進行系統(tǒng)級調(diào)試與驗證。
加分項：
1、熟悉Zynq SoC、ARM+FPGA協(xié)同設計，具備軟硬件協(xié)同調(diào)試能力。
2、具備Python/TCL腳本自動化測試經(jīng)驗。