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崗位職責(zé)：
1、負(fù)責(zé)處理器一致性總線的設(shè)計(jì)方案評(píng)估、優(yōu)化；
2、負(fù)責(zé)處理器一致性總線微架構(gòu)設(shè)計(jì)、RTL代碼開(kāi)發(fā)以及相關(guān)的驗(yàn)證工作；
3、負(fù)責(zé)總線模塊的時(shí)序和性能優(yōu)化；
任職要求：
1、 碩士及以上學(xué)歷，3年以上處理器一致性總線設(shè)計(jì)相關(guān)經(jīng)驗(yàn)；
2、熟悉數(shù)字電路設(shè)計(jì)，包括高速電路、低功耗和可測(cè)試性設(shè)計(jì)等；
3、 熟悉cache設(shè)計(jì)，熟悉多核一致性，
4、熟悉CXL、CHI、ACE、AXI總線；
5、 熟悉Verilog、System Verilog等基本硬件描述語(yǔ)言，具有豐富的IC設(shè)計(jì)經(jīng)驗(yàn)；
6、 熟悉底層硬件性能優(yōu)化技術(shù)和主流設(shè)計(jì)理念。