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崗位職責(zé)：
1、負(fù)責(zé)規(guī)劃高速接口，時鐘電路，Power電路的的技術(shù)路徑選擇
2、負(fù)責(zé)組建核心團(tuán)隊(duì)，對高速接口進(jìn)行技術(shù)突破和創(chuàng)新
3、負(fù)責(zé)統(tǒng)籌規(guī)劃建立高速完整研發(fā)，測試 flow
4、負(fù)責(zé)引領(lǐng)團(tuán)隊(duì)在下述方向或者其中之一方向的關(guān)鍵技術(shù)實(shí)現(xiàn)
1) 超高速TIADC設(shè)計(jì)和優(yōu)化，
2) 高性能，低功耗TX設(shè)計(jì)
3) 超低功耗，超低抖動PLL設(shè)計(jì)
4）AFE電路實(shí)現(xiàn)，如CTLE，VGA，DFE等
5）UCIE、DDR IO實(shí)現(xiàn)
6）DLL等時鐘路徑電路實(shí)現(xiàn)
7）LDO/DCDC等Power電路實(shí)現(xiàn)
8）PVT sensor電路實(shí)現(xiàn)
5、責(zé)團(tuán)隊(duì)能力建設(shè)，電路設(shè)計(jì)仿真指導(dǎo)，spec詳細(xì)分解
任職要求：
1、微電子相關(guān)專業(yè)碩士及以上學(xué)歷，相關(guān)領(lǐng)域5年以上經(jīng)驗(yàn)
2、有高速SerDes/ADDA/PLL/DDR/D2D/UCIE/Power等涉及電路的實(shí)際開發(fā)經(jīng)驗(yàn)
3、具備一定的項(xiàng)目管理經(jīng)驗(yàn)和團(tuán)隊(duì)管理經(jīng)驗(yàn)優(yōu)先考慮
4、有finfet電路實(shí)際設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先考慮