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崗位職責(zé)：
1、 參與數(shù)字前端產(chǎn)品邏輯架構(gòu)方案設(shè)計(jì)；
2、 負(fù)責(zé)FPGA軟件開發(fā)，系統(tǒng)聯(lián)試驗(yàn)證；
3、協(xié)助系統(tǒng)總體開展系統(tǒng)相關(guān)測試驗(yàn)證工作；
崗位要求：
1、具備相控陣數(shù)字DBF設(shè)計(jì)開發(fā)及調(diào)試經(jīng)驗(yàn)；
2、掌握陣列多通道ADC或DAC同步技術(shù)；
3、掌握DDC、DUC設(shè)計(jì)開發(fā)；
4、具備JESD204B、JESD204C、aurora、SRIO等高速接口開發(fā)經(jīng)驗(yàn)；
5、掌握ADC或DAC的應(yīng)用原理以及數(shù)字接收機(jī)基礎(chǔ)知識；
6、精通Verilog編程語言，熟練掌握xilinx FPGA編程開發(fā)環(huán)境的使用；
7、熟練閱讀硬件原理圖、PCB等設(shè)計(jì)文件；
8、具備一定的現(xiàn)場需求溝通能力，能夠獨(dú)立編寫負(fù)責(zé)部分的邏輯方案與開發(fā)相關(guān)文檔；
9、邏輯思維強(qiáng)，熱愛電子產(chǎn)品設(shè)計(jì)與開發(fā)；關(guān)文檔；
硬性要求：
1、電子、通信等相關(guān)專業(yè)；
2、10年以上FPGA應(yīng)用開發(fā)工作經(jīng)歷、5年以上通信或雷達(dá)專業(yè)領(lǐng)域應(yīng)用方面FPGA工程的獨(dú)立開發(fā)工作經(jīng)歷；
3、具有V7、K7或更大規(guī)模FPGA的工程開發(fā)經(jīng)歷；
優(yōu)先條件：
1 有軍品電子行業(yè)工作經(jīng)驗(yàn)優(yōu)先；
2、有雷達(dá)、通信方向陣列接收機(jī)及信號處理等相關(guān)工作經(jīng)歷優(yōu)先；
薪資福利：入職五險(xiǎn)一金、年終獎(jiǎng)2-6個(gè)月薪，司齡工資500元/月/增加1年、節(jié)假日福利禮金、生日福利禮金、年度體檢、年度調(diào)薪及不定期項(xiàng)目調(diào)薪、加班補(bǔ)貼、出差補(bǔ)貼、餐補(bǔ)等。
上下班時(shí)間：工作日9：00--17：30，中午12：00--13：30為午休時(shí)間；周末雙休。