職位描述
Verilog HDLVHDL
1. 負責FPGA的架構設計、RTL編碼（VHDL為主）、仿真驗證及時序優(yōu)化。
2. 開發(fā)工業(yè)自動化相關的高可靠性FPGA模塊，如：
- 高速數(shù)據(jù)采集與處理
- 實時通信協(xié)議（EtherCAT、PROFINET等）
- 電機控制/PWM生成
- 傳感器接口（ADC/DAC、SPI/I2C）
3. 配合硬件團隊完成FPGA與外圍電路的集成調試，解決信號完整性問題。
4. 編寫技術文檔（設計規(guī)范、測試報告等），支持產品量產與維護。
5. 參與工業(yè)自動化系統(tǒng)的需求分析，提出FPGA層面的解決方案。
---
任職要求
1. 必備技能：
- 本科及以上學歷，電子工程、通信、自動化等相關專業(yè)。
- 5年以上FPGA開發(fā)經驗，精通VHDL（Verilog可作為補充）。
- 熟悉Xilinx/Altera（Intel）FPGA開發(fā)流程（Vivado/Quartus）。
- 掌握數(shù)字電路設計（時序約束、跨時鐘域處理、低功耗優(yōu)化）。
- 熟練使用仿真工具（ModelSim、VCS等）和邏輯分析儀（ChipScope/SignalTap）。
2. 優(yōu)先條件：
- 有工業(yè)自動化、工控設備、機器人或電機控制相關項目經驗。
- 熟悉工業(yè)總線協(xié)議（如EtherCAT、CANopen、Modbus）。
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工作地點
上海浦東新區(qū)張江集電港
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段花娟/人事經理
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